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当 ldaxr 失效时：AArch64 上的独占访问与可缓存性
作者在开发自研内核时发现自旋锁中的 ldaxr 指令在 QEMU 运行正常，却在树莓派 5（Cortex-A76）上触发数据中止异常。深入排查揭示根本原因是 Cortex-A76 的全局独占监视器依赖缓存一致性逻辑，必须同时开启 SCTLR.C 并配置 Write-Back 内存属性。文章通过实验与架构文档比对，精准定位到 QEMU 未建模的可缓存性语义是模拟器与真机行为差异的根源。适合系统级程序员、嵌入式开发者或对 Arm 架构底层机制感兴趣的技术读者。原文 ↗
核心观点
- ▍在 Cortex-A76 上，ldaxr 指令的可缓存性要求比架构文档隐含的更为严格：必须同时满足 SCTLR.C 置 1（全局开启数据缓存）和页表描述符配置 Write-Back 属性，否则独占访问会触发数据中止异常。
- ▍QEMU 的默认行为掩盖了这一硬件级错误，因为它完全没有对可缓存性语义进行建模，使得在模拟器上编译运行的自旋锁代码无法在真实硬件上正常工作。
- 01实验 1：当 SCTLR.C 为默认值 0 且页表项配置 Normal Write-Back 时，ldaxr 引发 Data Abort。将 SCTLR.C 置 1 后，问题立即消失。
- 02实验 2：将页表项配置为 Write-Through 内存属性，即使 SCTLR.C 已置 1，ldaxr 依然会触发 Data Abort，说明只有 Write-Back 属性被 Cortex-A76 的全局独占监视器接受。
- 03作者查阅 Arm Cortex-A76 TRM 文档，发现全局独占监视器与缓存一致性硬件逻辑深度绑定，在不可缓存（Non-cacheable）内存上操作独占加载指令会导致未定义行为或异常。
- 04作者通过搜索 QEMU 源码提交记录（fa2ef212df、b0fe242751），确认 SCTLR_C 常量未被任何代码引用，证明 QEMU 完全没有模拟 cachable 行为。
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